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TMS320VC5407PGEデジタルシグナリングプロセッサは、高度に改良されたハーバードアーキテクチャに基づいており、1つのプログラムメモリバスと3つのデータメモリバスを備えています。これらのプロセッサは、高度な並列性を備えた算術論理ユニット(ALU)、アプリケーションに特化したハードウェア論理、オンチップメモリ、および追加のオンチップ周辺装置を提供します。これらのDSPの動作の柔軟性と速度は高度に専門化された命令セットに基づいています。

独立したプログラムとデータ空間は、プログラム命令とデータの同時アクセスを可能にし、高度な並列性を提供します。1つのサイクルで2つの読み出し動作と1つの書き込み動作を行うことができます。並列記憶とアプリケーションに特化した命令を持つ命令は、このアーキテクチャを活用することができます。また、データはデータ空間とプログラム空間の間で転送することができます。この並列性は強力な算術、論理、ビット操作のセットをサポートし、これらは1マシンサイクルで実行できます。DSPには割り込み、反復動作、関数呼び出しを管理する制御機構も含まれています。

製品:TMS320VC5407PGEです

コア:C54xです

クロック周波数は120MHzです

パッケージ:lqfp-144です。

特性です:

3つの独立した16ビットデータメモリバスと1つのプログラムメモリバスを備えた高度なマルチバスアーキテクチャです。

40ビット算術論理ユニット(ALU)は、1つの40ビットバケムシフタと2つの独立した40ビットアキュムレータから構成されます。

17−×17ビット並列乗算器は、非パイプライン単週期乗算/累積(ma)働作用の40ビット専用加算器に結合されます。

ビット比演算子の追加/比較選択を行うための比較、選択、記憶装置(CSSU)です

指数エンコーダは、40の指数値1週期ビットアキュムレータ値を計算します。

8個のサブレジスタと2個のサブレジスタ演算ユニット(ARAU)を備えた2つのアドレス生成器です

バスホルダー機能を備えたデータバスです

8M×16ビット最大アドレッシング可能外部プログラム空間の拡張アドレッシングモードです

オンチップROM

128K×16ビット(5407)構成プログラムメモリです

64K×16ビット(5404)はプログラムメモリとして構成されます。

オンチップRAM

40K×16ビット(5407)5つの8K×16ビットチップ上のデュアルチャネルモジュールからなるプログラム/データRAMです。

16 k ×16ビット(5404)8K×16ビットチップ2枚に2回線アクセスプログラム/データRAMを搭載しています。

拡張された外部パラレルインターフェース(XIO2)です

プログラムコードの単一命令反復とブロック反復動作です

より良いプログラムとデータ管理を可能にします

32ビットの長ワードオペランドを使った命令です

2つまたは3つのオペランドの読み出しを持つ命令です

並列記憶と並列ロードの算術命令があります

条件格納命令です

すぐに割り込みから戻ります

フィルム上外装です

ソフトウェアプログラム可能待機状態発生器とプログラム可能記憶領域の切り替えです

外部クロックソース付きチップ上プログラマブル位相ロックループ(PLL)クロックジェネレータ

16ビットタイマーが2つあります

6チャネルダイレクトメモリアクセス(DMA)コントローラです

3つのマルチチャネルバッファリングシリアルポート(McBSP)です

8/16ビット拡張型パラレルホストポート(hg 8/16)です。

< li>集積ボーレート発生器付き汎用非同期受信/送信机(UART)です。

電力消費制御は、ドロップモードIDLE1、IDLE2、IDLE3コマンドを備えています。

CLKOUTを無効にするため制御をオフにします。

IEEE Std 1149.1 (JTAG)境界走査ロジックはオンチップスキャンに基づいたアナログロジックです。

144ピン・ボール・ゲート・アレイ(BGA) (GGU)

144ピン薄型四角形平パッケージ(LQFP) (PGEサフィックス)です。

8.33-ns単週期定点命令実行時間(120 MIPS)です。

3.3-VI /O電源電圧です

1.5- Vコア電源電圧です