商品名称:5M160ZM100C5N
データマニュアル:5M160ZM100C5N.pdf
ブランド:Intel
年:23+
パッヶージ:100-TFBGA
納期:真新しいオリジナル
在庫数量:1000 件
5M160ZM100C5Nは、カスタムロジックを実装するための2次元行・列ベースのアーキテクチャを備えています。行と列の相互接続は、ロジック・アレイ・ブロック(LAB)間の信号相互接続を提供します。
以下のリストは、MAX Vデバイス・ファミリーの特徴をまとめたものです:
低コスト、低消費電力、不揮発性のCPLDアーキテクチャ
インスタント・オン(0.5ms以下)のコンフィグレーション時間
スタンバイ電流は25 µAと低く、高速パワーダウン/リセット動作が可能
高速伝搬遅延とクロック-出力時間
内部発振器
最大200 Mbpsのデータ・レートでエミュレーテッドRSDS出力をサポート
最大304Mbpsのデータ・レートでエミュレーテッドLVDS出力をサポート
4つのグローバル・クロック、ロジック・アレイ・ブロック(LAB)ごとに2つのクロックを使用可能
最大8Kビットのユーザー・フラッシュ・メモリ・ブロック(最大1000リード/ライト・サイクルの不揮発性ストレージ用
デバイス・コアに1.8Vの外部電源を供給
3.3V、2.5V、1.8V、1.5V、1.2Vのロジック・レベルをサポートするマルチボルトI/Oインターフェース
プログラム可能なスルー・レート、ドライブ強度、バス・ホールド、プログラム可能なプルアップ抵抗を含むバス・フレンドリー・アーキテクチャ
シュミット・トリガーによるノイズ耐性入力(ピンごとにプログラム可能)
I/Oは、3.3V動作のPCI-SIG® PCIローカルバス仕様、リビジョン2.2に完全準拠
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